Encounter数字IC设计平台
Cadence Encounter平台是一个综合的RTL-to-GDSII流程,面向90纳米及以下级别的复杂和低功耗设计。
为了在有限的上市时间内推出具有创新性的产品,企业需要将宝贵的工程设计资源投入到最具价值的地方——实现其设计的差异化。Cadence Encounter 数字IC设计平台提供了纳米级SoC设计所需的全方位的技术,帮助逻辑设计和物理实现团队快速完成高质量的芯片。
Encounter技术最理想的对象
· 超过3M单元的复杂设计
· 极具挑战性的低功耗设计
· 65纳米/45纳米设计及其它成品率考量的设计
· 混合信号设计
作为一个综合的RTL-to-GDSII设计环境,Encounter平台提供了一个完整的流程——从RTL综合和测试设计,到芯片虚拟原型和分割,再到最终时序和制造收敛。它提供了最高质量的芯片(时序、面积、线路功耗)、精确验证、注重信号完整性的布线、以及对高级65纳米设计至关重要的最新成品率和低功耗设计能力。通过Encounter技术,你可以提高生产力、管理复杂性,并且让你的产品更快上市。
Encounter平台产品提供了L、XL和GXL三类。
eMule链接 | |
[Cadence.IC设计.全资料教材].Cadence%20IC%E8%AE%BE%E8%AE%A1.rar | 99.86MB |
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《从零开始学电路基础》从零开始学电子技术丛书[PDF].... | 2011-05-31 |
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《Cadence IC设计 全资料教材》(Cadence... | 2010-10-05 |
邮箱Email:sales@ympcb.com
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